请教大家：高速AD在测试的时候需要进行阻抗匹配吗？# EE - 电子工程
l*i
1 楼
FLASH AD，输入信号频率大约在1G左右，似乎许多文献都没有提到输入阻抗匹配的问题
，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
配呢？谢谢！
，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
配呢？谢谢！
ET
2 楼
不需要吧。
需要的话，什么和什么匹配呢？
【在 l*****i 的大作中提到】
: FLASH AD，输入信号频率大约在1G左右，似乎许多文献都没有提到输入阻抗匹配的问题
: ，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
: 配呢？谢谢！
需要的话，什么和什么匹配呢？
【在 l*****i 的大作中提到】
: FLASH AD，输入信号频率大约在1G左右，似乎许多文献都没有提到输入阻抗匹配的问题
: ，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
: 配呢？谢谢！
k*f
3 楼
只是电压信号 信号源内阻比较小就可以了吧
z*n
4 楼
这个跟高速低速有何关系？
flash AD里面是resistor ladder，对频率没有选择吧？
【在 l*****i 的大作中提到】
: FLASH AD，输入信号频率大约在1G左右，似乎许多文献都没有提到输入阻抗匹配的问题
: ，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
: 配呢？谢谢！
flash AD里面是resistor ladder，对频率没有选择吧？
【在 l*****i 的大作中提到】
: FLASH AD，输入信号频率大约在1G左右，似乎许多文献都没有提到输入阻抗匹配的问题
: ，可是信号频率还是挺高的，所以有些疑惑。另外，如果是测高速DA，那是否也需要匹
: 配呢？谢谢！
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