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Ratio of PMOS and NMOS in the inverter?
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Ratio of PMOS and NMOS in the inverter?# EE - 电子工程
j*i
1
【 以下文字转载自 Visa 讨论区 】
发信人: jameslili (jamesli), 信区: Visa
标 题: 美国签证DS160表照片upload总是通不过,怎么办?
发信站: BBS 未名空间站 (Sun May 9 11:39:54 2010, 美东)
我上传ds160的照片总是通不过,不管我怎么改。
我的照片是美国店照的标准2英寸照片扫描的。每次都报错head size or relative
location不对.
请问有什么其他办法吗?比方说打印出来贴照片上去?多谢了。
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s*n
2
turbotax efiling rejected.
以前都是1040NR-EZ,头一次用efiling. 说AGI不对,给IRS打电话,说是0,填0,继续
被reject,不知道怎么办。
是不是只能paper filing?
谢谢
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m*c
3
design inverter,width of pmos = 2~3 nmos due to mobility reason, (un=2~3up)
,then both on-resistances are the same, thus rising and falling time the
same, and then?
1 then? Why rise and fall time should be the same?
2 noise margin?
3 design for analog or digital are the same request?
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w*y
4
再拍。。。

【在 j*******i 的大作中提到】
: 【 以下文字转载自 Visa 讨论区 】
: 发信人: jameslili (jamesli), 信区: Visa
: 标 题: 美国签证DS160表照片upload总是通不过,怎么办?
: 发信站: BBS 未名空间站 (Sun May 9 11:39:54 2010, 美东)
: 我上传ds160的照片总是通不过,不管我怎么改。
: 我的照片是美国店照的标准2英寸照片扫描的。每次都报错head size or relative
: location不对.
: 请问有什么其他办法吗?比方说打印出来贴照片上去?多谢了。

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f*3
5
上升下降时间相同是对普通电路而言,如果你有特殊的要求,例如缩短上升时间,当然
可以更改晶体管比例,这不是定死的。
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y*6
6
copy and paste on paint.
and edit the size and save as pdf.
you will see size smaller.

【在 j*******i 的大作中提到】
: 【 以下文字转载自 Visa 讨论区 】
: 发信人: jameslili (jamesli), 信区: Visa
: 标 题: 美国签证DS160表照片upload总是通不过,怎么办?
: 发信站: BBS 未名空间站 (Sun May 9 11:39:54 2010, 美东)
: 我上传ds160的照片总是通不过,不管我怎么改。
: 我的照片是美国店照的标准2英寸照片扫描的。每次都报错head size or relative
: location不对.
: 请问有什么其他办法吗?比方说打印出来贴照片上去?多谢了。

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p*a
7
digital的经典面试题...
不过我记得以前的课件里说过,ADC里上下沿不对称会导致2nd order harmonic,虽然
不知道为什么,同求解~
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b*r
8
inverter中width ratio是由switching point决定的吧,
也就是一般情况希望在输入为Vdd/2时,输出也为一半
此时经过pmos和nmos电流相同
beta_n/2*(Vsp-Vthn)^2=beta_p/2*(Vdd-Vsp-Vthp)^2;
Vsp = Vdd/2;
设Kpn=3Kpp,得Wp=3Wn
如果switching point不在中点,比如过高4/5Vdd,如果信号在Vdd,刚下降Vdd/5,
inverter已经工作,如果信号在GND,要让输入到达4/5Vdd,inverter才工作
baker的书有很好解释

3up)

【在 m**c 的大作中提到】
: design inverter,width of pmos = 2~3 nmos due to mobility reason, (un=2~3up)
: ,then both on-resistances are the same, thus rising and falling time the
: same, and then?
: 1 then? Why rise and fall time should be the same?
: 2 noise margin?
: 3 design for analog or digital are the same request?

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M*y
9

baker的书?具体是哪一本?最近也在准备这方面的知识面试。

【在 b****r 的大作中提到】
: inverter中width ratio是由switching point决定的吧,
: 也就是一般情况希望在输入为Vdd/2时,输出也为一半
: 此时经过pmos和nmos电流相同
: beta_n/2*(Vsp-Vthn)^2=beta_p/2*(Vdd-Vsp-Vthp)^2;
: Vsp = Vdd/2;
: 设Kpn=3Kpp,得Wp=3Wn
: 如果switching point不在中点,比如过高4/5Vdd,如果信号在Vdd,刚下降Vdd/5,
: inverter已经工作,如果信号在GND,要让输入到达4/5Vdd,inverter才工作
: baker的书有很好解释
:

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b*r
10
CMOS Circuit Design, Layout, and Simulation
有一章从analog的角度讲逻辑电路
可以买一本第二版的,比最新版少最后两章
我买了本几乎全新的,加运费不到十刀
祝好运

【在 M****y 的大作中提到】
:
: baker的书?具体是哪一本?最近也在准备这方面的知识面试。

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