M*s
2 楼
☆─────────────────────────────────────☆
dillongeo (dillongeo) 于 (Mon May 5 12:14:03 2008) 提到:
这学期一门课我和两外两个美国小本做project，可这两人太懒了，基本上design和
coding都是我一个人做。在交上去的source code里只有我一个作者的名字，因为他们
根本没有参与。昨晚熬通宵改coding，交之前本来还想要不要干脆把我的名字去掉，让
老师不要为难那两小本，可想着这段时间都是我一个人苦干累得要死，实在气不过就发
出去了。现在老师发信问怎么source code只有我一个人的作者名字。
或许我作为team leader和他们沟通不够，可是这一两个月来我给他们发了N封email，
问他们进展如何，有什么问题，可这两个家伙基本上是ignore我的email的。
☆─────────────────────────────────────☆
joeblackgod (Goddy) 于 (Mon May 5 14:08:14 2008) 提到:
建议你直接跟
dillongeo (dillongeo) 于 (Mon May 5 12:14:03 2008) 提到:
这学期一门课我和两外两个美国小本做project，可这两人太懒了，基本上design和
coding都是我一个人做。在交上去的source code里只有我一个作者的名字，因为他们
根本没有参与。昨晚熬通宵改coding，交之前本来还想要不要干脆把我的名字去掉，让
老师不要为难那两小本，可想着这段时间都是我一个人苦干累得要死，实在气不过就发
出去了。现在老师发信问怎么source code只有我一个人的作者名字。
或许我作为team leader和他们沟通不够，可是这一两个月来我给他们发了N封email，
问他们进展如何，有什么问题，可这两个家伙基本上是ignore我的email的。
☆─────────────────────────────────────☆
joeblackgod (Goddy) 于 (Mon May 5 14:08:14 2008) 提到:
建议你直接跟
l*8
3 楼
c*n
4 楼
情节老套，演技特烂，对话刻板
还是看看过去的film noir把，那是情节剧和演技的经典
现在hollywood的大趋势是忽略故事情节和演技，过于重视电脑特技这种雕虫小技，还
有那些过于做作的哗众取宠的对白，只是为了几秒钟的刺激
还是看看过去的film noir把，那是情节剧和演技的经典
现在hollywood的大趋势是忽略故事情节和演技，过于重视电脑特技这种雕虫小技，还
有那些过于做作的哗众取宠的对白，只是为了几秒钟的刺激
p*g
5 楼
像是在天空游荡
l*n
6 楼
时不时的就又不能愉快的生活了，每天都过得很快，而且生活中每天都有很多不合理的
地方，看了很多的心灵鸡汤，要教导我们不去care那些乱七八糟的事情，不要去在乎身
外之物，一定要看淡一些名利，可是又有几个人能做到的。
我一直在努力，但是从来未做到过。
比如你付出了劳动，boss不给你工资，怎么能不care？
还有别人跟你约好了的，几点钟集合，结果你被放鸽子了，白白浪费了几个小时的时间
在那里等，最后人家告诉你来不了了，突然有急事了，这样做的往往是客户，但是你又
如何能做到不care？
这些事情我都遇到过，除此之外，还有很多不合理的事情，甚至我无法去以牙还牙，比
如客户迟到和爽约，我也不能怎样，客户的利益毫无损失，而我拜拜耗费了时间和精力
，这些能怎么办呢？
这种郁闷的事情，除了努力的开导自己，然后在郁闷几天或者几个小时之后再重新快乐
起来，没有别的办法，然而懊恼的是，每天都有这样的事情，每天都要努力的开导自己
，那就很累人了，好像到一个没有烦恼的地方去，终于理解有人去隐居深山了。
地方，看了很多的心灵鸡汤，要教导我们不去care那些乱七八糟的事情，不要去在乎身
外之物，一定要看淡一些名利，可是又有几个人能做到的。
我一直在努力，但是从来未做到过。
比如你付出了劳动，boss不给你工资，怎么能不care？
还有别人跟你约好了的，几点钟集合，结果你被放鸽子了，白白浪费了几个小时的时间
在那里等，最后人家告诉你来不了了，突然有急事了，这样做的往往是客户，但是你又
如何能做到不care？
这些事情我都遇到过，除此之外，还有很多不合理的事情，甚至我无法去以牙还牙，比
如客户迟到和爽约，我也不能怎样，客户的利益毫无损失，而我拜拜耗费了时间和精力
，这些能怎么办呢？
这种郁闷的事情，除了努力的开导自己，然后在郁闷几天或者几个小时之后再重新快乐
起来，没有别的办法，然而懊恼的是，每天都有这样的事情，每天都要努力的开导自己
，那就很累人了，好像到一个没有烦恼的地方去，终于理解有人去隐居深山了。
g*7
7 楼
经常需要处理比较大的csv文件(csv)，1G - 2G。
文件中是股票的历史价格，大概10余列的数据，有varchar,double,int, date type
需要在Python下实现一个压缩程序，请问大家有什么建议？
谢谢。
文件中是股票的历史价格，大概10余列的数据，有varchar,double,int, date type
需要在Python下实现一个压缩程序，请问大家有什么建议？
谢谢。
t*9
8 楼
俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
t*y
9 楼
其实一两个礼拜前就出来了...只是没人敢公开的放而已
B*i
10 楼
It would be ur fault if you're the leader. Should try to hold on them as
the project starts. However, you did the most job and reserved the credit!
the project starts. However, you did the most job and reserved the credit!
r*e
11 楼
很神奇...角度,光线都很有帮助...
【在 p*********g 的大作中提到】
: 像是在天空游荡
【在 p*********g 的大作中提到】
: 像是在天空游荡
X*r
12 楼
用现成的模块就好：
http://docs.python.org/release/2.5.2/lib/archiving.html
【在 g****7 的大作中提到】
: 经常需要处理比较大的csv文件(csv)，1G - 2G。
: 文件中是股票的历史价格，大概10余列的数据，有varchar,double,int, date type
: 需要在Python下实现一个压缩程序，请问大家有什么建议？
: 谢谢。
http://docs.python.org/release/2.5.2/lib/archiving.html
【在 g****7 的大作中提到】
: 经常需要处理比较大的csv文件(csv)，1G - 2G。
: 文件中是股票的历史价格，大概10余列的数据，有varchar,double,int, date type
: 需要在Python下实现一个压缩程序，请问大家有什么建议？
: 谢谢。
t*9
13 楼
为啥没人搭理呀？
s*d
14 楼
应该是出了，已经看到720p下载了。
【在 a9 的大作中提到】
: 怎么已经有种子下载了。
【在 a9 的大作中提到】
: 怎么已经有种子下载了。
b*g
15 楼
mosis.com
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
N*w
16 楼
哇，哪里？
【在 s*******d 的大作中提到】
: 应该是出了，已经看到720p下载了。
【在 s*******d 的大作中提到】
: 应该是出了，已经看到720p下载了。
t*9
17 楼
为啥没人搭理呀？
c*h
18 楼
电驴
【在 N****w 的大作中提到】
: 哇，哪里？
【在 N****w 的大作中提到】
: 哇，哪里？
b*g
19 楼
mosis.com
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
t*9
20 楼
这个没法儿用呀 ～ 再求 TSMC 的 .35 / .25 / .18 的库 ～～ 都是些很成熟的东东呀
【在 b****g 的大作中提到】
: mosis.com
【在 b****g 的大作中提到】
: mosis.com
a*e
21 楼
在DC/doc/下有DEMO 的LIBRARY。0.13的。
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
【在 t*****9 的大作中提到】
: 俺装了个 Synopsis DC, 哪位大侠给个能用的 db file 让俺练练手呀 ？谢了先
t*9
22 楼
.13 的用不上 ~~
【在 a******e 的大作中提到】
: 在DC/doc/下有DEMO 的LIBRARY。0.13的。
【在 a******e 的大作中提到】
: 在DC/doc/下有DEMO 的LIBRARY。0.13的。
i*e
23 楼
那个db库自己都能写的。写个.lib然后转换成.db就能用了。
要现成的可以去下osu的：http://vlsiarch.ecen.okstate.edu/flows/
【在 t*****9 的大作中提到】
: .13 的用不上 ~~
要现成的可以去下osu的：http://vlsiarch.ecen.okstate.edu/flows/
【在 t*****9 的大作中提到】
: .13 的用不上 ~~
a*e
24 楼
你有Synopsys的Solvnet户头吗？有的话可以去以下下载
http://www.synopsys.com/Community/UniversityProgram/Pages/defau
90nm Generic Library Content
Technology Kit
The Technology Kit includes a databook and user guide, symbols, .lib,
Verilog and VHDL simulation models, DRC and LVS decks, HSPICE netlists,
extracted C/RC netlists, GDSII layout views, LEF files, generic SPICE models
, fram views, layout views and runset files.
Digital Standard Cell Library
The Digital Standard Cell Library consists of 340 cells to optimize the IC
design. The library includes typical miscellaneous combinational and
sequential logic cells for different drive strengths. It has all the
required deliverables for low power design including support for IC designs
with different core voltages to minimize dynamic and leakage power.
I/O Standard Cell Library
The I/O Standard Cell Library consists of 50 standard and 3 special I/O
cells: digital, analog, power/ground pads for different loads and
miscellaneous cells. The library is designed for 1.2V/2.5V operation with a
process technology of 1P9M 1.2V/2.5V and an operating frequency of 100 MHz.
The library is provided in two versions: wire-bond and flip-chip.
Memories
Memories include 35 medium-sized RAMs (SRAMs). They are synchronous dual-
port with write enable, output enable, and chip select on each port. They
have the same architecture and vary in size.
Phase Locked Loop (PLL)
The Phase Locked Loop (PLL) clock multiplier circuit can generate a stable,
high-speed clock from a slower clock signal. It has 3 operating modes:
normal, external feedback and bypass.
References
The 90nm Generic Library contains 21 megacells for OpenSPARC and 15
megacells for IBM PowerPC 405 that are needed to fully implement the
processors in a design. Additionally, two low-power designs (ChipTop and
Orca) and two sample designs for OpenSPARC T1 and PowerPC 405 are also
included.
OpenSPARC megacells are memory cells (SRAMs and CAMs) that are needed to
fully implement the OpenSPARC processor. These megacells are designed using
the 90nm Generic Library.
ChipTop is a processor architecture that features the Unified Power Format (
UPF) for advanced low power designs. This reference, with included memory
blocks, can be used with the 90nm Generic Library and design tools to
understand the implementation of low power design methodologies and design
for low power. The Orca design contains one functional block of the Orca
processor. This reference can be used with the 90nm Generic Library to
understand the basic design steps when using logical (DC) and physical (ICC)
design tools.
【在 i*****e 的大作中提到】
: 那个db库自己都能写的。写个.lib然后转换成.db就能用了。
: 要现成的可以去下osu的：http://vlsiarch.ecen.okstate.edu/flows/
http://www.synopsys.com/Community/UniversityProgram/Pages/defau
90nm Generic Library Content
Technology Kit
The Technology Kit includes a databook and user guide, symbols, .lib,
Verilog and VHDL simulation models, DRC and LVS decks, HSPICE netlists,
extracted C/RC netlists, GDSII layout views, LEF files, generic SPICE models
, fram views, layout views and runset files.
Digital Standard Cell Library
The Digital Standard Cell Library consists of 340 cells to optimize the IC
design. The library includes typical miscellaneous combinational and
sequential logic cells for different drive strengths. It has all the
required deliverables for low power design including support for IC designs
with different core voltages to minimize dynamic and leakage power.
I/O Standard Cell Library
The I/O Standard Cell Library consists of 50 standard and 3 special I/O
cells: digital, analog, power/ground pads for different loads and
miscellaneous cells. The library is designed for 1.2V/2.5V operation with a
process technology of 1P9M 1.2V/2.5V and an operating frequency of 100 MHz.
The library is provided in two versions: wire-bond and flip-chip.
Memories
Memories include 35 medium-sized RAMs (SRAMs). They are synchronous dual-
port with write enable, output enable, and chip select on each port. They
have the same architecture and vary in size.
Phase Locked Loop (PLL)
The Phase Locked Loop (PLL) clock multiplier circuit can generate a stable,
high-speed clock from a slower clock signal. It has 3 operating modes:
normal, external feedback and bypass.
References
The 90nm Generic Library contains 21 megacells for OpenSPARC and 15
megacells for IBM PowerPC 405 that are needed to fully implement the
processors in a design. Additionally, two low-power designs (ChipTop and
Orca) and two sample designs for OpenSPARC T1 and PowerPC 405 are also
included.
OpenSPARC megacells are memory cells (SRAMs and CAMs) that are needed to
fully implement the OpenSPARC processor. These megacells are designed using
the 90nm Generic Library.
ChipTop is a processor architecture that features the Unified Power Format (
UPF) for advanced low power designs. This reference, with included memory
blocks, can be used with the 90nm Generic Library and design tools to
understand the implementation of low power design methodologies and design
for low power. The Orca design contains one functional block of the Orca
processor. This reference can be used with the 90nm Generic Library to
understand the basic design steps when using logical (DC) and physical (ICC)
design tools.
【在 i*****e 的大作中提到】
: 那个db库自己都能写的。写个.lib然后转换成.db就能用了。
: 要现成的可以去下osu的：http://vlsiarch.ecen.okstate.edu/flows/
t*9
25 楼
用公司的 email 申请过，一直 pending 着啦 ～～而且也用不着90nm 那么高的
technology
好像有专门的 account manager 管着，不是个人能够下载的
models
【在 a******e 的大作中提到】
: 你有Synopsys的Solvnet户头吗？有的话可以去以下下载
: http://www.synopsys.com/Community/UniversityProgram/Pages/defau
: 90nm Generic Library Content
: Technology Kit
: The Technology Kit includes a databook and user guide, symbols, .lib,
: Verilog and VHDL simulation models, DRC and LVS decks, HSPICE netlists,
: extracted C/RC netlists, GDSII layout views, LEF files, generic SPICE models
: , fram views, layout views and runset files.
: Digital Standard Cell Library
: The Digital Standard Cell Library consists of 340 cells to optimize the IC
technology
好像有专门的 account manager 管着，不是个人能够下载的
models
【在 a******e 的大作中提到】
: 你有Synopsys的Solvnet户头吗？有的话可以去以下下载
: http://www.synopsys.com/Community/UniversityProgram/Pages/defau
: 90nm Generic Library Content
: Technology Kit
: The Technology Kit includes a databook and user guide, symbols, .lib,
: Verilog and VHDL simulation models, DRC and LVS decks, HSPICE netlists,
: extracted C/RC netlists, GDSII layout views, LEF files, generic SPICE models
: , fram views, layout views and runset files.
: Digital Standard Cell Library
: The Digital Standard Cell Library consists of 340 cells to optimize the IC
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